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delphi怎么做网站,wordpress json数据库,中英文网站用同域名,企业宣传ppt案例欣赏之前分享过一篇文章《FPGA 版本管理三种方式#xff1a;你会选哪一种#xff1f;》#xff0c;评论区很多人都推荐使用Git进行版本管理#xff0c;今天这篇文章主题就是使用Git进行备份指南。在 FPGA 开发中#xff0c;掌握 Git 等源码管理工具已经是必备技能。当然#…之前分享过一篇文章《FPGA 版本管理三种方式你会选哪一种》评论区很多人都推荐使用Git进行版本管理今天这篇文章主题就是使用Git进行备份指南。在 FPGA 开发中掌握 Git 等源码管理工具已经是必备技能。当然在使用 Vivado 时我们不仅需要处理源代码控制还需要处理以 IP 为中心的设计产品。Vivado 的工程通常是 IP 为中心 的设计包含IP Integrator Block Diagram各类 IP 实例独立 IP 或 BD 内 IP自动生成的包装文件与工程产物这让很多 FPGA 工程师一开始会觉得“Vivado 项目到底该怎么和 Git 一起用”好消息是从 Vivado 2022.1 开始这一切已经变得非常清晰、也非常容易。Vivado 2022.1 之后最重要的变化源文件与生成文件分离在 Vivado 2022.1 之前源文件和生成文件全部混在同一个 .srcs 目录中。而从 Vivado 2022.1 起工程目录被明确拆分为.srcs源文件.gen生成文件这一点非常关键。 这意味着只要我们保存 .srcs 目录 .xpr 工程文件就可以在任何地方完整重建 Vivado 工程。示例工程说明示例使用 Vivado 2024.1 创建了一个新工程目标板卡为 Avnet ZU Board。IP Integrator 设计包含Zynq MPSoC Processing SystemSmart InterconnectAXI BRAM Controller此外还加入了 自定义 RTL 文件通过 UART 提供 AXI 访问用来演示 自定义 RTL 与 IP 设计共存 的情况。完成后的 Block Diagram 如下Vivado 工程目录结构解析1️⃣ .srcs 目录imports/ 下是用户添加的 VHDL / Verilog 源文件bd/ 下是 IP Integrator 的 Block Diagramip/ 下是各个 IP 的 .xci 配置文件 这些都是必须纳入 Git 管理的内容2️⃣ .gen 目录.gen 中包含自动生成的顶层 wrapperIP 的生成文件综合与仿真所需的中间文件 这些文件不需要提交到 Git将 Vivado 工程加入 Git 仓库假设你已经在 GitHub 上创建了一个空仓库下面是核心的步骤。初始化仓库git init添加 Vivado 工程文件只需要添加两部分git add git_demo.srcs/* git add git_demo.xpr提交到本地仓库提交这些文件并附带一条消息。git commit -m initial issue你会看到.xprRTL / VHDL 文件IP .xci 文件都已经被 Git 跟踪。绑定远程仓库并推送git remote add origin url git push -u origin master此时在 GitHub 网页上就可以看到完整的 Vivado 工程源文件了。从 Git 仓库重建 Vivado 工程为了验证流程是否正确我们新建一个文件夹git clone repo_url然后直接打开 .xpr 文件。我们需要重新生成顶层 wrapper重新生成 IP正常完成综合与实现即可。整个流程无需额外脚本运行非常顺利。小结Vivado 2022.1 之后工程结构已经非常适合 Git 管理只需管理 .srcs .xprIP、BD、RTL 都能自然融入 Git 流程Vivado 工程终于可以像软件工程一样被“正常管理”上面只是简单的使用后续文章将继续介绍高级点的用法及 Vitis 与源码管理的协同方式。